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66759821 混合處理模塊

混合處理模塊采用PPC+FPGA+AD/DA的架構(gòu)。AD芯片采集模擬單元輸出的中頻信號(hào)，通過ADC模數(shù)轉(zhuǎn)換成數(shù)字信號(hào)，并通過JESD204B高速接口傳輸?shù)?/span>FPGA。PPC和FPGA進(jìn)行數(shù)字算法處理后，再通過DA芯片輸出中頻信號(hào)到射頻功放模塊，完成設(shè)備射頻信號(hào)的發(fā)射功能。同時(shí)設(shè)計(jì)2路QSFP+光纖接口，單Lane最高設(shè)計(jì)速率為10.3125Gbps，用于接收光纖信號(hào)。整板采用網(wǎng)絡(luò)接口及低速接口實(shí)現(xiàn)管理控制命令的傳輸。


功能特點(diǎn)

    a. 對(duì)下變頻通道輸出信號(hào)進(jìn)行AD采樣；

    b. 具備DA輸出功能；

    c. 處理器和FPGA之間同時(shí)可傳輸數(shù)據(jù)流（采用SRIO接口）；

    d. 具備千兆網(wǎng)絡(luò)通信能力，具備萬兆網(wǎng)通信能力；

    e. 具備40Gbps QSFP+傳輸能力；

    f. 具備溫度監(jiān)測、電源管理、自檢等功能。


性能指標(biāo)

         ? ADC:

                       采樣率≥3000Msps，位寬≥14bit

                       SNR≥52dB，頻率1.56~2.76GHz

                       SFDR≥60dB，頻率1.56~2.76GHz

                       輸入平均功率-50 ~ 0dBm，衰減調(diào)節(jié)20dB

         ? DAC:

                       采樣率≥于6000Msps，位寬≥14bit

                       輸出頻率0.75~1.95GHz

                       輸出信號(hào)功率-55 ~ -5dBm

         ? FPGA:

                       Xilinx XCKU115

                       包含兩組DDR，每組DDR都具有讀寫能力，每組DDR有效帶寬大于等于50Gbps

         ? 處理器: T2080

         ? DDR3: 速率800Mbps                  

         ? 光纖: 2組QSFP+接口 ，速率為10.3125Gbps

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